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在高速数字系统设计中,信号完整性(SI)问题以及互连延迟引起的时序问题致关重要.分析了嵌入式视频系统高速数字的信号完整性问题,使用串行端接和分支总线拓扑解决信号完整性问题,通过Protel DXP 2004进行SI仿真验证;并以DM642与SDRAM之间的时序为例,对信号时序进行分析.
嵌入式视频系统中高速信号完整性分析
【摘 要】
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在高速数字系统设计中,信号完整性(SI)问题以及互连延迟引起的时序问题致关重要.分析了嵌入式视频系统高速数字的信号完整性问题,使用串行端接和分支总线拓扑解决信号完整性
【机 构】
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北京邮电大学电子工程学院
【出 处】
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电子器件
【发表日期】
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2005年4期
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