65nm CMOS工艺的低功耗加固12T存储单元设计

来源 :计算机辅助设计与图形学学报 | 被引量 : 8次 | 上传用户：sunshineaigeng

【摘要】

：

随着CMOS工艺尺寸的不断缩减,存储单元对高能辐射粒子变得更加敏感,由此产生的软错误和因电荷共享导致的双节点翻转急剧增多.为了提高存储单元的可靠性,提出一种由4个PMOS晶体管和8个NMOS晶体管组成的抗辐射加固12T存储单元,并由NMOS晶体管中的N_1和N_2以及N_3和N_4构成了堆叠结构来降低存储单元的功耗;其基于物理翻转机制避免了存储节点产生负向的瞬态脉冲,在存储节点之间引入的负反馈机制

【作者】

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黄正峰李雪健鲁迎春欧阳一鸣方祥圣易茂祥梁华国倪天明

【机构】

：

合肥工业大学电子科学与应用物理学院合肥 230009合肥工业大学计算机与信息学院合肥 230009;安徽行政学院信息工程系合肥 230059;安徽工程大学电气工程学院芜湖 241000;

【出处】

：

计算机辅助设计与图形学学报

【发表日期】

：

2019年03期

【关键词】

：

抗辐射加固设计软错误单粒子翻转存取可靠性存储单元

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