【摘 要】
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针对传统数字锁相环锁相范围小、速度低、精度差等问题，提出了一种自适应快速锁定全数字锁相环（all digital phase-locked loop,ADPLL）。采用PI控制与自适应控制相结合的方法，根据输入相位误差及频率大小，自适应控制器自动改变PI参数，提高了锁相速度并保证了锁相精度；同时环路滤波器采用具有比例积分特性的数字环路滤波器，该环路滤波器易于进行线性描述，并可以保证整个锁相系统稳态
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针对传统数字锁相环锁相范围小、速度低、精度差等问题，提出了一种自适应快速锁定全数字锁相环（all digital phase-locked loop,ADPLL）。采用PI控制与自适应控制相结合的方法，根据输入相位误差及频率大小，自适应控制器自动改变PI参数，提高了锁相速度并保证了锁相精度；同时环路滤波器采用具有比例积分特性的数字环路滤波器，该环路滤波器易于进行线性描述，并可以保证整个锁相系统稳态静差小，有较小的输出抖动。对提出的锁相环进行理论分析，并采用Verilog HDL语言编写相关代码，采用QuartusⅡ和Modelsim软件进行联合仿真，仿真证明该数字锁相环锁相范围大、速度快、精度高。
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