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介绍了一种固定信号格式的并串转换电路设计,利用VHDL语言对一片复杂可编程逻辑器件（CPLD）进行编程,实现特定的串行码的输出。完成了电路原理图的设计和VHDL代码的编写,并在QuartusⅡ开发软件上实现了功能仿真和时序仿真,将程序配置到目标器件中进行验证,可以实现预定功能。
一种基于CPLD的串行码发生器设计
【摘 要】
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介绍了一种固定信号格式的并串转换电路设计,利用VHDL语言对一片复杂可编程逻辑器件（CPLD）进行编程,实现特定的串行码的输出。完成了电路原理图的设计和VHDL代码的编写,并在Qua
【机 构】
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第二炮兵工程学院101教研室
【出 处】
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电子测量技术
【发表日期】
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2010年9期
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