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随着集成电路特征尺寸进入纳米级，高能粒子造成的软错误已对电路的正常工作构成严重威胁。流水线电路具有工作频率高、时序单元数量多的特点，易受软错误影响。本文对时序单元进行容错性能分析，并结合流水线电路的特点，利用新型容错时序单元结构，提出了一种容软错误的流水线电路设计方案。
流水线电路的容错设计
【摘 要】
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随着集成电路特征尺寸进入纳米级，高能粒子造成的软错误已对电路的正常工作构成严重威胁。流水线电路具有工作频率高、时序单元数量多的特点，易受软错误影响。本文对时序单元进
【机 构】
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合肥工业大学计算机与信息学院,合肥工业大学电子科学与应用物理学院
【出 处】
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微型机与应用
【发表日期】
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2010年9期
【基金项目】
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基金项目：国家自然科学基金资助项目（608760281,博士点基金资助项目（200803590006）,国家自然科学基金重点资助项目（60633060）,安徽省海外高层次人才项目f20082014）
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