【摘 要】
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多输入多输出(MIMO)技术在现代无线移动通信系统中应用广泛,FPGA实现MIMO信道估计和解码是其实用化的关键。为保证系统性能,设计了一种OFDM-MIMO系统的并行流水浮点4×6 MIMO
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多输入多输出(MIMO)技术在现代无线移动通信系统中应用广泛,FPGA实现MIMO信道估计和解码是其实用化的关键。为保证系统性能,设计了一种OFDM-MIMO系统的并行流水浮点4×6 MIMO信道解码器,并在单片Xilinx Vertix6 FPGA芯片上进行了实现。实验结果表明,系统处理速率可以达到120 MHz,可以用于速率为1.485 Gbit/s的HDI高清视频的实时传输。
Multi-input multiple-output (MIMO) technology is widely used in modern wireless mobile communication systems. The key to practical application of MIMO channel estimation and decoding is FPGA. In order to ensure system performance, a parallel pipeline floating point 4 × 6 MIMO channel decoder for OFDM-MIMO system is designed and implemented on a single chip Xilinx Vertix6 FPGA. Experimental results show that the system processing rate can reach 120 MHz and can be used for real-time transmission of HDI HD video at the rate of 1.485 Gbit / s.
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