基于Verilog-HDL的逻辑分析卡中双向端口的设计

来源 :太原理工大学学报 | 被引量 : 0次 | 上传用户：majixiong0

【摘要】

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介绍了自行设计逻辑分析卡的系统构成,给出各个功能模块的逻辑框图.然后,从应用的角度简单介绍了ISSI公司的静态RAM芯片IS61LV256,并阐明了将其作为逻辑分析卡外部RAM的使用

【作者】

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王海渊常晓明李媛

【机构】

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太原理工大学,信息工程学院,山西,太原,030024太原理工大学,计算机与软件工程学院,山西,太原,030024;天津工业大学,计算机技术与自动化学院,天津,300160;

【出处】

：

太原理工大学学报

【发表日期】

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2006年4期

【关键词】

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Verilog-HDL 逻辑分析卡 inout 硬件测试法 RAM

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介绍了自行设计逻辑分析卡的系统构成,给出各个功能模块的逻辑框图.然后,从应用的角度简单介绍了ISSI公司的静态RAM芯片IS61LV256,并阐明了将其作为逻辑分析卡外部RAM的使用方法,设计了该RAM与CPLD的硬件接口.应用Verilog-HDL语言对双向(inout)端口所进行了描述,在此基础上以一个简化了的双向(inout)端口模块为例,设计了对该双向(inout)端口的仿真方法,并给出了仿真结果.最后给出一种简易的硬件测试方法对双向(inout)端口进行测试,证明了该设计以及对其的仿真的正确性.

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