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对比分析了高复杂度（RDO_on）和低复杂度（RDO_off）帧间宏块编码模式选择的硬件实现代价，给出了H．264／AVC编码器系统芯片的低复杂度帧间宏块编码模式选择的VLSI设计；并在AlteraDE2开发板上进行了FPGA验证。
H．264／AVC帧间宏块编码模式选择的VLSI设计
【摘 要】
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对比分析了高复杂度（RDO_on）和低复杂度（RDO_off）帧间宏块编码模式选择的硬件实现代价，给出了H．264／AVC编码器系统芯片的低复杂度帧间宏块编码模式选择的VLSI设计；并在AlteraDE2开发
【机 构】
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安康学院电子与信息技术研究中心,北京大学软件与微电子学院
【出 处】
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电视技术
【发表日期】
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2007年12期
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