【摘 要】
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笔者运用FPGA技术,通过使用开发工具Platform Designer,给出一种拥有Avalon总线接口、实现等精度测频功能的自定义IP(Intellectual Property,知识产权)核的设计方案。不但能
【基金项目】
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国家自然科学基金“CCFD非线性自干扰模型及高抑制比技术研究”(项目编号:61961016),湖北省自然科学基金“5G同频同时全双工(CCFD)自干扰消除模型研究”(项目编号:2019CFB593),湖北民族大学博士科研启动基金项目“针对OFDM数字基带发生器的IFFT处理器”(项目编号:MY2018B08)。
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笔者运用FPGA技术,通过使用开发工具Platform Designer,给出一种拥有Avalon总线接口、实现等精度测频功能的自定义IP(Intellectual Property,知识产权)核的设计方案。不但能解决传统测频方法存在的±1误差问题,还能轻易实现单路或多路同时进行等精度测频,待测信号的最低频率可低至0.5 Hz,最高频率可高达200 MHz。测试结果表明,系统的测频精度可达到10-8。本文给出基于Avalon总线的等精度测频IP核的设计思想、封装流程以及利用Nios II处理器进行访问控制
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