【摘 要】
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对传统全数字锁相环锁相周期长、时间数字转换电路量化误差较大等问题，提出了一种在高分辨率时间数字转换器的基础上能够快速锁相的全数字锁相环．本设计提出的相调模块将量化的
【机 构】
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中国地质大学（武汉）机械与电子信息学院
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对传统全数字锁相环锁相周期长、时间数字转换电路量化误差较大等问题，提出了一种在高分辨率时间数字转换器的基础上能够快速锁相的全数字锁相环．本设计提出的相调模块将量化的相位差还原成时间序列，并在状态机的控制下加入到重构信号中，从而能够在检测到相位差之后的最多两个输入参考时钟周期内使相位一次性对齐，锁相时间控制在0．72μs之内；设计的上升沿检测电路能够在重构与参考信号同频时，准确地检测两者上升沿是否同时到来并给出相应的使能信号，从而在锁相时关闭时间数字转换电路，大大降低了电路的功耗；优化了多时钟多相位的时间数
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