【摘 要】
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采用SMIC 180nm CMOS工艺,设计了一款用于脉冲超宽带系统的锁相环型小数频率综合器。使用闪烁噪声抑制技术、感性峰化技术和动态反馈技术,分别对正交压控振荡器、预分频器以
【机 构】
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中国科学技术大学电子科学与技术系,中国科学技术大学信息科学实验中心,
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采用SMIC 180nm CMOS工艺,设计了一款用于脉冲超宽带系统的锁相环型小数频率综合器。使用闪烁噪声抑制技术、感性峰化技术和动态反馈技术,分别对正交压控振荡器、预分频器以及电荷泵的性能进行了优化。测试结果表明,该频率综合器芯片能稳定工作在7.45GHz,功耗为27mW,带内和带外1MHz处相位噪声分别为-70dBc/Hz和-111.3dBc/Hz。
Using a SMIC 180nm CMOS process, a phase-locked loop fractional-frequency synthesizer for pulse ultra-wideband systems is designed. The performance of quadrature voltage-controlled oscillator, prescaler, and charge pump are optimized using flicker noise suppression, inductive peaking, and dynamic feedback techniques. The test results show that the frequency synthesizer chip can work stably at 7.45GHz and power consumption is 27mW. The phase noise at-band and out-band at 1MHz is -70dBc / Hz and -111.3dBc / Hz, respectively.
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