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分析了HDMI2.0版标准的加解扰算法,使用硬件描述语言Verilog HDL设计了加解扰器电路,选用FPGA开发平台进行了原型验证.验证结果表明,该设计正确实现了加解扰器的功能,符合HDMI2.0版标准的要求,可应用于系统设计中.
基于HDMI2.0的加解扰器设计
【摘 要】
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分析了HDMI2.0版标准的加解扰算法,使用硬件描述语言Verilog HDL设计了加解扰器电路,选用FPGA开发平台进行了原型验证.验证结果表明,该设计正确实现了加解扰器的功能,符合HDM
【机 构】
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龙迅半导体(合肥)股份有限公司,安徽合肥,230001
【出 处】
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电子技术
【发表日期】
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2018年3期
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