【摘 要】
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本文研究了通用循环冗余校验（CRC）编码器的结构,分析了限制编码速度提高的关键原因。依据状态空间理论对编码器建模,经过系统的可观性分解,将反馈逻辑对应电路的关键路径限制到
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本文研究了通用循环冗余校验（CRC）编码器的结构,分析了限制编码速度提高的关键原因。依据状态空间理论对编码器建模,经过系统的可观性分解,将反馈逻辑对应电路的关键路径限制到最多2个xor门,并采用流水线技术,优化了控制转移矩阵和状态输出矩阵对应的逻辑电路。综合结果表明,在0.18μm工艺下,最高工作频率可达310.5MHz,最大的吞吐量为10Gbps。
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