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浮点运算器的核心运算部件是浮点加法器，它是实现浮点指令各种运算的基础，其设计优化对于提高浮点运算的速度和精度相当关键。文章从浮点加法器算法和电路实现的角度给出设计方法，通过VHDL语言在QuartusⅡ中进行设计和验证，此加法器通过状态机控制运算，有效地降低了功耗，提高了速度，改善了性能。
FPU加法器的设计与实现
【摘 要】
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浮点运算器的核心运算部件是浮点加法器，它是实现浮点指令各种运算的基础，其设计优化对于提高浮点运算的速度和精度相当关键。文章从浮点加法器算法和电路实现的角度给出设计方
【机 构】
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商洛学院计算机科学系
【出 处】
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电子设计工程
【发表日期】
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2012年12期
【基金项目】
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商洛学院科研基金项目（09SKY004）
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