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高速FIR滤波器是数字接收机中中频处理的满足不了要求,而基于FPGA的硬件设计在速度上有很大的优势.因此,研究了采用DA算法的FIR硬件设计,分析了如何在逻辑资源占用和处理速度上进一步提高性能,并以16抽头8 bits FIR滤波器为例在XCS05的FPGA芯片中进行了实现.
基于DA算法的FIR滤波器硬件实现
【摘 要】
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高速FIR滤波器是数字接收机中中频处理的满足不了要求,而基于FPGA的硬件设计在速度上有很大的优势.因此,研究了采用DA算法的FIR硬件设计,分析了如何在逻辑资源占用和处理速度
【机 构】
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解放军理工大学
【出 处】
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解放军理工大学学报(自然科学版)
【发表日期】
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2003年3期
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