【摘 要】
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为提高蜗杆测量精度，设计了新的测量机测头数据采集电路。基于FPGA并采用自顶向下设计方法和Verilog HDL编程技术，设计了采集电路的逻辑控制模块。基于AD977设计了三通道模数转
【基金项目】
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国家自然科学基金资助项目（51475351）,陕西省协同创新计划项目（2015XT-32）
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为提高蜗杆测量精度，设计了新的测量机测头数据采集电路。基于FPGA并采用自顶向下设计方法和Verilog HDL编程技术，设计了采集电路的逻辑控制模块。基于AD977设计了三通道模数转换电路，每通道由独立的模数转换器及其前端信号调理电路构成。FPGA与前端模数转换电路以及后端数据总线之间均设计了电平转换电路。对所设计电路在测量机上进行了综合噪声实际测试，结果表明所采集数据的样本标准差均低于0．5μm，达到了预期目的。
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