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期刊论文
基于Verilog的全数字锁相环的设计
基于Verilog的全数字锁相环的设计
来源 :渭南师范学院学报 | 被引量 : 0次 | 上传用户:youkangstrong
【摘 要】
:
文章介绍了全数字锁相环的基本结构和工作原理,提出了一种基于verilog的全数字锁相环的设计方法,并利用QuartusII6.0软件对设计进行了时序仿真.
【作 者】
:
刘永勤
【机 构】
:
渭南师范学院物理与电子工程系
【出 处】
:
渭南师范学院学报
【发表日期】
:
2010年5期
【关键词】
:
全数字锁相环
VERILOG
FPGA
DPLL
Verilog
FPGA
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文章介绍了全数字锁相环的基本结构和工作原理,提出了一种基于verilog的全数字锁相环的设计方法,并利用QuartusII6.0软件对设计进行了时序仿真.
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