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卷积码Viterbi译码器的FPGA设计与实现
卷积码Viterbi译码器的FPGA设计与实现
来源 :现代电子技术 | 被引量 : 0次 | 上传用户:jiemei2007126
【摘 要】
:
主要介绍了卷积码中Viterbi译码器的FPGA实现方案.方案中设计了幸存路径交换寄存器模块,充分利用FPGA中丰富的触发器资源,减小了译码器状态控制的复杂度,提高了VB译码器的运
【作 者】
:
刘建强
殷贤华
【机 构】
:
桂林电子工业学院电子工程系
【出 处】
:
现代电子技术
【发表日期】
:
2004年9期
【关键词】
:
卷积码
VITERBI算法
FPGA
VB
RSC
Viterbi algorithm
FPGA
VB
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主要介绍了卷积码中Viterbi译码器的FPGA实现方案.方案中设计了幸存路径交换寄存器模块,充分利用FPGA中丰富的触发器资源,减小了译码器状态控制的复杂度,提高了VB译码器的运行速度.
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