卷积码Viterbi译码器的FPGA设计与实现

来源 :现代电子技术 | 被引量 : 0次 | 上传用户:jiemei2007126
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主要介绍了卷积码中Viterbi译码器的FPGA实现方案.方案中设计了幸存路径交换寄存器模块,充分利用FPGA中丰富的触发器资源,减小了译码器状态控制的复杂度,提高了VB译码器的运行速度.
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