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提出了一种6个加数的并行加法器及其接口扩展的研究方案．论述了所提新型加法器的工作原理和过程，同时描述了接口扩充思想．最后，采用MAX＋PLUSⅡ对设计电路进行了模拟验证．实验结果说明了所提加法器的设计合理性，也证明了该加法器对6个加数的计算比采用串行累加更快．
6加数并行加法器及扩展接口的研究
【摘 要】
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提出了一种6个加数的并行加法器及其接口扩展的研究方案．论述了所提新型加法器的工作原理和过程，同时描述了接口扩充思想．最后，采用MAX＋PLUSⅡ对设计电路进行了模拟验证．实验结果说
【机 构】
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阜阳师范学院物理与电子科学学院,合肥工业大学应用物理系
【出 处】
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微电子学与计算机
【发表日期】
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2009年12期
【基金项目】
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安徽省高校省级自然科学研究资金项目（2006KJ042B）
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