一种基于SOC应用的Rail-to-Rail运算放大器IP核

来源 :西安电子科技大学学报 | 被引量 : 0次 | 上传用户：qqqq_eeqg

【摘要】

：

采用上华0.6μm DPDM CMOS工艺,设计实现了一种基于片上系统应用的低功耗、高增益Rail-to-Rail运算放大器IP核.基于BSIM3V3 Spice模型,采用Hspice对整个电路进行仿真,在5V的

【作者】

：

翟艳杨银堂朱樟明王帆

【机构】

：

西安电子科技大学

【出处】

：

西安电子科技大学学报

【发表日期】

：

2005年1期

【关键词】

：

RAIL-TO-RAIL CMOS 运算放大器 IP核片上系统 Rail-to-Rail CMOS operational amplifier IP core

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采用上华0.6μm DPDM CMOS工艺,设计实现了一种基于片上系统应用的低功耗、高增益Rail-to-Rail运算放大器IP核.基于BSIM3V3 Spice模型,采用Hspice对整个电路进行仿真,在5V的单电源电压工作条件下,直流开环增益达到l07.8dB,相位裕度为62.4°,单位增益带宽为4.3MHz,功耗只有0.34mW.

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