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VHDL的综合问题是当前EDA研究的一个重要课题.针对VHDL复杂的语法结构，尤其是表达式的多样性，给出一个表达式的可综合语法检查器.通过改变VHDL表达式的产生式来解决在语法分析时遇到的二义性问题.最后给出表达式主要的产生式及测试结果.
VHDL表达式的可综合语法检查器
【摘 要】
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VHDL的综合问题是当前EDA研究的一个重要课题.针对VHDL复杂的语法结构，尤其是表达式的多样性，给出一个表达式的可综合语法检查器.通过改变VHDL表达式的产生式来解决在语法分析
【机 构】
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上海交通大学大规模集成电路研究所
【出 处】
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上海交通大学学报
【发表日期】
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2001年2期
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