【摘 要】
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Viterbi译码器中的大容量、宽带宽存储器限制了译码器的速度和系统的功耗 ,合理地组织这个存储器是提高译码器速度 ,降低系统功耗的关键。从电路系统角度分析了 Viterbi译码
【机 构】
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Viterbi译码器中的大容量、宽带宽存储器限制了译码器的速度和系统的功耗 ,合理地组织这个存储器是提高译码器速度 ,降低系统功耗的关键。从电路系统角度分析了 Viterbi译码器的结构 ,提出了一种优化设计方案。
Viterbi decoder in the large-capacity, wide bandwidth memory limit the speed of the decoder and system power consumption, reasonable organization of this memory is to improve the decoder speed, reducing system power consumption key. The structure of Viterbi decoder is analyzed from the perspective of circuit system, and an optimized design scheme is proposed.
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