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针对基于异或阵列实现的8bit CRC32硬件计算模块资源占用大、实测计算效率低的问题，设计了表格驱动的32bit CRC32硬件计算模块．并封装为wishbone总线接口的IP核，该IP核在Altera FPGA上实测计算效率是快速软件算法的15倍。
基于Wishbone总线的CRC32 IP核的设计
【摘 要】
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针对基于异或阵列实现的8bit CRC32硬件计算模块资源占用大、实测计算效率低的问题，设计了表格驱动的32bit CRC32硬件计算模块．并封装为wishbone总线接口的IP核，该IP核在Altera
【机 构】
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山东科技大学电子信息科学与技术系
【出 处】
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微计算机信息
【发表日期】
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2010年11期
【基金项目】
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山东科技大学春蕾计划资助
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