10 bit 80 Msample/s流水线ADC的电路级设计

来源 :电子器件 | 被引量 : 0次 | 上传用户：wuang810

【摘要】

：

实现了0.18μmCMOS模拟工艺、1.8V电源电压下10位分辨率、80MHz采样率的流水线ADC的电路级设计,采用栅压自举的采样开关和增益提升运放保证ADC的精度;采用复位结构的SHC和MDA

【作者】

：

郑晓燕仇玉林

【机构】

：

中国科学院微电子研究所,中国科学院微电子研究所北京

【出处】

：

电子器件

【发表日期】

：

2007年5期

【关键词】

：

模数转换器流水线栅压自举开关增益提升运放 analog-to-digital converter pipeline signal dependent

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实现了0.18μmCMOS模拟工艺、1.8V电源电压下10位分辨率、80MHz采样率的流水线ADC的电路级设计,采用栅压自举的采样开关和增益提升运放保证ADC的精度;采用复位结构的SHC和MDAC消除运放失调电压的影响;采用动态比较器并优化每级电容以降低功耗.当输入信号幅度为1Vpp时,ADC在整个量化范围内无失码,当输入信号频率为39MHz时,可获得71.6dB的无失真动态范围和60.56dB的信噪失真比.

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