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介绍一种用VHDL(VHSIC Hardware Description Language)语言设计的全双工异步串行通讯,用在分布式测试控制平台中,实现各个组合间的数据通讯.系统采用双时钟设计结构,使得奇校验电路结构简单、易实现.经实验和现场调试完全达到设计要求.
一种用VHDL设计的全双工异步串行通讯方式
【摘 要】
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介绍一种用VHDL(VHSIC Hardware Description Language)语言设计的全双工异步串行通讯,用在分布式测试控制平台中,实现各个组合间的数据通讯.系统采用双时钟设计结构,使得奇
【机 构】
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空军工程大学导弹学院
【出 处】
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空军工程大学学报(自然科学版)
【发表日期】
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2003年2期
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