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介绍基于Verilog HDL设计的曼彻斯特编解码器模块,对曼彻斯特编解码器的原理进行介绍和分析,解决其编码和解码的同步问题,能够使解码器数据采样结果正确可靠,实现其编码和解码模块化,使用Verilog HDL语言实现曼彻斯特编解码器的核心功能,并且在ModelSim上实现其功能仿真。
基于FPGA的曼彻斯特编解码器设计与实现
【摘 要】
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介绍基于Verilog HDL设计的曼彻斯特编解码器模块,对曼彻斯特编解码器的原理进行介绍和分析,解决其编码和解码的同步问题,能够使解码器数据采样结果正确可靠,实现其编码和解
【机 构】
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暨南大学信息技术研究所
【出 处】
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现代计算机(专业版)
【发表日期】
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2010年12期
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