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设计了一种用于高速高分辨率ADC的运算放大器。电路采用全差分结构,以及运用了增益提高技术的折叠式共源共栅放大器,以满足高速、高精度的要求。仿真结果表明,运放的增益达到85d B,带宽为785MHZ,有较大的压摆率,能满足12位40MS/s采样保持电路的应用。
适用于高速高分辨率ADC的CMOS运算放大器设计
【摘 要】
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设计了一种用于高速高分辨率ADC的运算放大器。电路采用全差分结构,以及运用了增益提高技术的折叠式共源共栅放大器,以满足高速、高精度的要求。仿真结果表明,运放的增益达到
【机 构】
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福州大学物理与信息学院
【出 处】
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福建电脑
【发表日期】
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2017年10期
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