【摘 要】
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小数延时电路是高速数模转换器(DAC)中的关键电路,采用小数延迟电路能够实现高速系统链路中不同通道间延时的匹配.文中首先分析了基于Farrow结构的拉格朗日插值滤波器,其次对
【机 构】
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南京电子技术研究所,南京210039
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小数延时电路是高速数模转换器(DAC)中的关键电路,采用小数延迟电路能够实现高速系统链路中不同通道间延时的匹配.文中首先分析了基于Farrow结构的拉格朗日插值滤波器,其次对小数延时滤波器算法进行了原型的仿真验证,然后,采用Verilog硬件描述语言对延迟电路进行了实现并完成逻辑仿真验证,最后在55 nm CMOS工艺完成了版图实现,并通过后仿真,完成了芯片流片.测试结果表明在2.5 GHz外部时钟频率下,在奈奎斯特带宽内能够实现1/200采样周期精度的小数延迟性能.
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