全局自动图像配准算法加速器

来源 :计算机辅助设计与图形学学报 | 被引量 : 10次 | 上传用户：a442697259

【摘要】

：

由于全局自动图像配准算法计算和存储复杂度高,不易实现实时处理,为此提出一种改进的基于块的全局自动图像配准算法加速器结构(BWAGIR II).该结构采用双组多体存储结构及优化的数据放置策略,支持在单个时钟周期内同时读取4×4插值窗口中的16个像素值;并采用定浮混合计算逻辑,以支持定点和浮点操作数的混合计算.FPGA实现结果表明,采用文中结构对5个BWAGIR II处理单元的数据吞吐率超过258×1

【作者】

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李宝峰田宝华张晓明郑明玲

【机构】

：

国防科学技术大学计算机学院

【出处】

：

计算机辅助设计与图形学学报

【发表日期】

：

2012年10期

【关键词】

：

图像配准并行处理算法加速器 FPGA image registration parallel processing accelerator FPGA

【基金项目】

：

国家“八六三”高技术研究发展计划（2012AA01A301）.

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