【摘 要】
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传统SARADC结构在高采样速率高精度运行时,会导致功率效率降低。因此,提出了一种新型的10位50Msample/s混合结构两步式ADC,分别采用逐次接近寄存器(SAR)ADC和基于时间-数字转
【基金项目】
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国家自然科学基金项目(61572356).
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传统SARADC结构在高采样速率高精度运行时,会导致功率效率降低。因此,提出了一种新型的10位50Msample/s混合结构两步式ADC,分别采用逐次接近寄存器(SAR)ADC和基于时间-数字转换器(TDC)的ADC作为粗和精转换器。通过结合SAR和TDC架构的优点,无需高增益放大器来实现倍增数模转换器高线性度,提出的架构可以在不影响操作速度的情况下实现ADC功耗降低。另外,两个数字误差校正分别用于补偿TDC误差和最终ADC输出。采用0.13μmCOMS工艺进行了具体实现,面积为0.12mm2。测试结果显
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