【摘 要】
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针对单片闪速存储器NAND FLASH容量相对小、存储速度相对低且存在随机无效块等问题,提出一种由单片NAND FLASH构建大容量高速存储阵列并根据阵列的结构特点管理无效块的方法
【机 构】
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中北大学仪器科学与动态测试教育部重点实验室
【基金项目】
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重点实验室基金（9140C12040206060C12）
论文部分内容阅读
针对单片闪速存储器NAND FLASH容量相对小、存储速度相对低且存在随机无效块等问题,提出一种由单片NAND FLASH构建大容量高速存储阵列并根据阵列的结构特点管理无效块的方法。深入分析阵列存储方式及位扩展、时分多路复用等关键技术,针对复杂的阵列组成提出四种无效块管理机制：全相关、全独立、行相关、列相关等。各相关模块独立建立无效块标识区,统一管理本相关模块的无效块,保证存储过程中CPU能快速定位到有效块地址值。最后通过实验验证了系统的存储容量和存储速度均达到预期目标。
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