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本文介绍了一种适用于高速差分数据接收的CMOS串并转换电路,该电路主要由时钟电路、1:2数据分割电路和1:5分接器组成。采用65nm工艺,仿真结果表明,在数据传输速度为5Gb/s时功耗为12mW。
基于65nm CMOS工艺的高速串并转换电路设计
【摘 要】
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本文介绍了一种适用于高速差分数据接收的CMOS串并转换电路,该电路主要由时钟电路、1:2数据分割电路和1:5分接器组成。采用65nm工艺,仿真结果表明,在数据传输速度为5Gb/s时功
【机 构】
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中国电子科技集团公司第三十八研究所集成电路设计中心
【出 处】
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中国集成电路
【发表日期】
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2012年04期
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