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选择时钟方案是同步时序集成电路设计的前提.本文阐述了两相时钟方案的规则,通过比较一相时钟与两相时钟方案,给出了两相时钟方案用于同步时序电路设计的优点.最后结合例子简要介绍了该方案在VERILOG HDL中的应用及其注意事项.
两相时钟方案
【摘 要】
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选择时钟方案是同步时序集成电路设计的前提.本文阐述了两相时钟方案的规则,通过比较一相时钟与两相时钟方案,给出了两相时钟方案用于同步时序电路设计的优点.最后结合例子简
【机 构】
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华中科技大学图像识别与人工智能研究所,激光技术国家重点实验室
【出 处】
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半导体技术
【发表日期】
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2003年9期
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