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在诸如信息安全应用领域中，除法运算特别是大数（多个机器字长整数）除法运算速度是制约公钥密码算法运算速度提高的瓶颈。针对公钥密码算法VLSI实现需要，本文在介绍SD数据表示的基础提出了一种新的大数除法算法，并给出了其VLSI实现逻辑结构。实验结果表明，这种除法器的VLSI实现具有很好的性价比。
基于SD数据表示的大数除法VLSI高速实现
【摘 要】
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在诸如信息安全应用领域中，除法运算特别是大数（多个机器字长整数）除法运算速度是制约公钥密码算法运算速度提高的瓶颈。针对公钥密码算法VLSI实现需要，本文在介绍SD数据表示的基
【机 构】
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国防科技大学计算机学院
【出 处】
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计算机工程与科学
【发表日期】
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2006年8期
【基金项目】
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国家自然科学基金资助项目（60173040）,国家863计划资助项目（2002AAIZ1080）
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