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高级加密标准（AES）的传统实现方法是对加/解密算法进行单独设计,占用了过多的硬件资源。该文在分析AES加/解密算法机理的基础上,介绍了算法各模块的设计方法,通过分析提取了加/解密算法之间存在的共性,给出算法的可重构设计实例。通过FPGA仿真验证,该方案与传统设计方案相比,减少了资源的消耗。
基于FPGA的AES加/解密算法的可重构设计
【摘 要】
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高级加密标准（AES）的传统实现方法是对加/解密算法进行单独设计,占用了过多的硬件资源。该文在分析AES加/解密算法机理的基础上,介绍了算法各模块的设计方法,通过分析提取了加/
【机 构】
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解放军信息工程大学电子技术学院
【出 处】
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计算机工程
【发表日期】
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2008年7期
【基金项目】
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国家部委预研基金资助重点项目
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