QAM解调芯片中Reed-Solomon解码模块的设计

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Reed-Solomon编码(简称RS编码)是存在于当今数字电子系统中非常重要的一类编码,利用它的算法特性可以实现适应多种需要的纠错技术。由于其优秀的纠正随机和突发连续误码的性能,RS码在数据通信、卫星通信及存储器等领域获得了极其广泛的应用,同时,它也是欧洲电信标准协会(ETSI)关于有线信道部分的传播标准,即DVB-C标准的重要组成部分。RS编码器和解码器的实现比较复杂,同时,其算法及运算均基于有限域理论。因此本文从介绍必需的迦罗华域基础理论开始,论述了RS编码及解码原理和相关算法,然后针对本文实现目标——HDTV解调芯片中前向纠错部分的RS解码模块,着重比较几种解码方法,由此确定了解码器设计方案。在此基础上,本文设计了符合DVB-C标准的RS(204, 188)解码器的各模块结构组成,该解码器采用基于改进的欧几里德(ME)算法的时域解码结构,其中在执行核心功能的ME算法模块中,通过将其清晰划分为阶数计算和多项式计算两个功能模块,并利用多项式首项系数交叉相乘抵消的思路,有效地避免了传统核心算法模块中的多项式除法运算,从而减小了模块规模和硬件实现的复杂度。本文采用VHDL语言对解码器各部分进行了详细设计,通过了模块仿真和验证,并给出了关键电路的仿真结果、模块相关参数分析,结果表明,本文所设计的RS解码器可以对符合DVB-C标准的比特流进行解码,适合于HDTV机顶盒等应用场合。
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