TV导引头图像I/O接口及字符叠加技术研究

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在TV制导技术中通过字符叠加将图像跟踪的信息如偏航角及俯仰角的大小、跟踪框及跟踪十字线的位置等叠加到图像上显示,可以使图像跟踪的结果更加直观,方便操控人员对图像跟踪进行控制。本文设计了一个以FPGA为核心的字符叠加系统,整个系统由FPGA、CCD、解码器SAA7113、编码器SAA7121和监视器组成。CCD采集模拟视频信号;解码器将模拟视频信号转换成数字视频信号;编码器将数字视频信号转换成模拟视频信号;SRAM实现数字视频信号的存储;监视器显示处理后的模拟视频信号;FPGA实现的功能模块主要包括I2C总线控制模块、图像采集模块、通信模块和字符叠加模块。本文采用Verilog HDL实现图像的实时采集及字符叠加,系统设计及仿真是在QuartusⅡ和Modelsim软件平台下进行的。研究工作对FPGA在实时图像处理系统中的应用做了有益的尝试,对基于FPGA的实时图像处理系统的实现有着积极的意义。
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