【摘 要】
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随着超大规模集成电路工艺的发展，电路规模越来越大，电路设计的复杂度越来越大，这对于电子设计自动化提出了严峻的挑战。高级综合工具可以在很大的设计空间中选择最优的设计方案
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随着超大规模集成电路工艺的发展，电路规模越来越大，电路设计的复杂度越来越大，这对于电子设计自动化提出了严峻的挑战。高级综合工具可以在很大的设计空间中选择最优的设计方案。利用综合手段，至少可以得到如下收益： (1) 缩短设计周期，降低设计成本。 (2) 减少设计错误。采用经过验证的自动综合工具，可以消除大部分可能由人工带来的设计错误。 (3) 可以在多个设计方案中进行比较。 (4) 容易适应性能指标的部分改变。 特征尺寸进入0.35μm后，互连线延迟占到系统延迟的70％以上，而延迟参数的分布又取决于版图的具体实现，导致时序收敛成为设计的首要问题，因此综合技术必须要基于时序，保证时序收敛。 论文的重点是： (1) 不同加工工艺下综合手段的实现； (2) 基于时序驱动的综合手段的探索； (3) 静态时序分析的实现。 本文的研究成果已成功应用在8位RISC MCU的设计上。
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