基于JPEG2000的高分辨率雷达图像处理系统设计及实现

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图像采集处理与传输系统作为一种重要的现代技术,在智能交通、电力、通讯、计算机视觉、军事等领域广泛应用。随着DSP技术的发展,在DSP上用软件实现实时视频压缩成为数字视频压缩标准应用的亮点,这种应用比起专门的压缩芯片更具有灵活性和升级潜力。 本课题的主要内容是设计一种基于PC104总线,以FPGA为系统控制核心、TIDM642为GPU的可相对实时采集高分辨率视频高速处理的图像处理系统。主要从系统级别上描述了一种高分辨率图像处理卡的系统实现方案,重点研究了该视频图像处理卡中视频采集、压缩编码和视频数据通信的方法。 本文主要提出了一种基于JPEG2000的视频编码器的软件实现方法和TIDM642的外围硬件系统设计。在本设计中提出利用Altera公司的CycloneIEP1C6的FPGA芯片完成高清VGA图像信号的精确采集,并利用其完成复杂而高速的逻辑控制及时序设计,实现了与PC104上位机接口程序设计,并将采集的数字视频信号存储在外扩存储空间SDR-SDRAM中;利用TIDM642完成将采集到的数字图像信息按照JPEG2000压缩编码标准进行处理。利用FPGA与上位机程序接口可以实现板卡与PC机的信息交互,如上位机的控制信息和板卡图像压缩完成信息等等。 验证结果表明,本文所述的系统方案设计可以方便的应用在基于PC104总线的高分辨率图像实时处理系统中,并能有效完成I2C配置、PC-FPGA交互通信,FPGA对SDR-SDRAM高速读写控制,DSP对图像进行压缩等系统功能。
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