基于二阶电路的缓冲器时延模型

来源 :2005全国微波毫米波会议 | 被引量 : 0次 | 上传用户:gn64954
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随着VLSI集成度与工作频率的提高,时延问题已成为影响芯片性到深亚微米级,互连线时延比重已经占据总时延的绝大部分.为了减小互连线时延,缓冲器插入是当前一种常见且有效的方法.但插入缓冲器会引入新的时延问题,因而如何建立一个精确的缓冲器时延模型,是本文研究的重点.
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