高速流水线数组处理机EZ-AP的设计

来源 :全国青年计算机工作者学术交流会 | 被引量 : 0次 | 上传用户：yy04081406

【摘要】

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介绍了应用大规模集成电路构成的高速流水线数组处理机EZ-AP的研制背景，以及设计指标、指令系统、体系结构等设计特点。该机主频15MC，字长32位，峰值速度可达30MFLOPS，由MECL10900

【作者】

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王德州

【机构】

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中国科学院计算技术研究所

【出处】

：

全国青年计算机工作者学术交流会

【发表日期】

：

1987年期

【关键词】

：

高速流水线数组处理机设计特点指令系统研制背景体系结构设计指标规模集成电路构成峰值速度通用性组件字长应用数据

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介绍了应用大规模集成电路构成的高速流水线数组处理机EZ-AP的研制背景，以及设计指标、指令系统、体系结构等设计特点。该机主频15MC，字长32位，峰值速度可达30MFLOPS，由MECL10900和MECL10800等系列组件构成。虽主要用于大型数组数据的“乘加”处理，但由于其设计特点，它具有较好的通用性。（本刊录）

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