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本文提出了一种改进的Cache写缓冲器的方案,将缓冲器的一次写阻塞变成了可冗余两次写阻塞的结构,并分析了这种情况下的加速比,并给出了相关的证明.
冗余阻塞Cache缓冲器设计
【摘 要】
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本文提出了一种改进的Cache写缓冲器的方案,将缓冲器的一次写阻塞变成了可冗余两次写阻塞的结构,并分析了这种情况下的加速比,并给出了相关的证明.
【机 构】
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国防科学技术大学计算机学院(长沙)
【出 处】
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第八届计算机工程与工艺全国学术年会
【发表日期】
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2003年期
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