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会议论文
用CPLD实现ADS8322与高速FIFO的接口
用CPLD实现ADS8322与高速FIFO的接口
来源 :2010年河南省单片微机和嵌入式系统学术研讨会 | 被引量 : 0次 | 上传用户:freeboy033
【摘 要】
:
以CPLD为逻辑控制核心实现了ADS8322与高速FIFO的接口电路,该电路具有可靠性高、通用性强、易于移植等特点。在设计过程中,以QuartusII作为开发环境,采用图形输入和VerilogH
【作 者】
:
童建国
刘冠英
谢志伟
【出 处】
:
2010年河南省单片微机和嵌入式系统学术研讨会
【发表日期】
:
2010年期
【关键词】
:
CPLD
ADS8322
高速
FIFO
VerilogHDL
语言输入
图形输入
设计过程
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以CPLD为逻辑控制核心实现了ADS8322与高速FIFO的接口电路,该电路具有可靠性高、通用性强、易于移植等特点。在设计过程中,以QuartusII作为开发环境,采用图形输入和VerilogHDL语言输入相结合的方式,简化了开发流程。
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