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嵌入式高集成度DRAM ECC电路纠错码的选择及性能评估
嵌入式高集成度DRAM ECC电路纠错码的选择及性能评估
来源 :第十四届全国半导体集成电路、硅材料学术年会 | 被引量 : 0次 | 上传用户:sam_rao
【摘 要】
:
本文比较了三种广泛应用于存储器的32-bitSEC-DED编码的性能和纠错能力,并根据电路,在以上编码的思想的基础上,提出了一种在编码延迟和多比特错误发现率上有明显优势的编码,F
【作 者】
:
赵欣
刘伯安
陈宏毅
【机 构】
:
清华大学微电子所,北京,100084
【出 处】
:
第十四届全国半导体集成电路、硅材料学术年会
【发表日期】
:
2005年期
【关键词】
:
嵌入式
高集成度
电路
纠错码
选择
编码
错误发现率
硬件实现
纠错能力
多比特
存储器
应用
延迟
性能
思想
评估
基础
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论文部分内容阅读
本文比较了三种广泛应用于存储器的32-bitSEC-DED编码的性能和纠错能力,并根据电路,在以上编码的思想的基础上,提出了一种在编码延迟和多比特错误发现率上有明显优势的编码,Fast;同时对硬件实现的主要开销进行了评估.
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