【摘 要】
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本数字频率计采用以FPGA为核心器件设计。设计的过程用VHDL语言实现测频,测周等模块,用单片机进行显示器等硬件控制,C语言实现其软件控制。对于Quartus II设计工具而言,与Ver
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本数字频率计采用以FPGA为核心器件设计。设计的过程用VHDL语言实现测频,测周等模块,用单片机进行显示器等硬件控制,C语言实现其软件控制。对于Quartus II设计工具而言,与Verilog及VHDL的设计流程是完全支持的,Quartus II设计工具内部嵌入了Verilog逻辑综合器,Quartus II最大的优势之一在于能够利用第三方工具。基于QuartusⅡ的VHDL的设计方法电子系统的设计方法和"自顶向下"与"自底向上"的设计方法。
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