【摘 要】
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文章提出了一种新型传输管全加器,该全加器采用互补传输管逻辑(ComplementaryPass-TransistorLog-ic)实现。与现有的CPL全加器相比:该全加器具有面积、进位速度和功耗上的优
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文章提出了一种新型传输管全加器,该全加器采用互补传输管逻辑(ComplementaryPass-TransistorLog-ic)实现。与现有的CPL全加器相比:该全加器具有面积、进位速度和功耗上的优势;并且提供了进位传播信号的输出,可以更简单的构成旁路进位加法器(CarrySkipAdder)。在此全加器基础上可以实现一种新型行波进位加法器(RippleCarryAdder),其内部进位信号处于非全摆幅状态,具有高速低功耗的特点。HSPICE模拟表明:对4位加法器而言,其速度接近CMOS提前进位加法器(CarryLookaheadAdder),而功耗减小了61%。适用于高性能、低功耗的VLSI电路设计。
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