低密度奇偶校验码在数字信号处理器上的实现

来源 :华侨大学学报(自然科学版) | 被引量 : 0次 | 上传用户：rwuinthe3924

【摘要】

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研究低密度奇偶校验码（LDPC）的数字信号处理实现，并采用TMS320C5409DSP芯片进行算法实现．优化和积算法中的具体运算，调整译码顺序，将硬判决放入变量节点中运算，校验和放入校验节点运

【作者】

：

陈燕

【机构】

：

华侨大学信息科学与工程学院

【出处】

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华侨大学学报(自然科学版)

【发表日期】

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2010年2期

【关键词】

：

低密度奇偶校验码数字信号处理器译码校验

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研究低密度奇偶校验码（LDPC）的数字信号处理实现，并采用TMS320C5409DSP芯片进行算法实现．优化和积算法中的具体运算，调整译码顺序，将硬判决放入变量节点中运算，校验和放入校验节点运算中，避免重复寻址，给出与现场可编程门阵列的通信方法．在时钟频率为20MHz，译码迭代次数为10次时，测试得到的速率为20．4kbit·s^-1．

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