基于Verilog语言的DMA控制器的设计与仿真

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DMA是存储器直接存取(Direct Memory Access)方式的缩写,它是指一种高速的数据传输操作方式,允许在外部设备和存储器之间直接读写数据而不需要通过CPU暂存。整个数据传输操作需要在DMA控制器(DMAC)控制下占用系统总线来完成。采用DMA控制器来控制内存与外设之间的数据交流,不需要CPU的干预,减少了中间环节,所以可以大大提高数据传送的速率。由于计算机技术的飞速发展,CPU的运行速度越来越快,使得DMA控制器的研究与设计越来越受到关注。本文首先介绍了DMA技术的基本概念,而后介绍了DMA控制器的基本功能、基本结构和工作原理等。在此基础上,基于Verilog HDL语言设计出一个同步DMA控制器的电路系统,并利用Modelsim SE 5.6b对源程序进行了编译和功能仿真,最后利用Synplify 7.3.4对电路进行了综合实现。本文在基于Verilog HDL设计DMA控制器时,采用的是Top-Down的设计方法。DMA控制器电路系统是由数据寄存器、地址产生器、状态控制器三个子模块组成,并且整个DMA控制器电路系统的编译、仿真和综合是在对三个子模块分别进行编译、仿真和综合的基础上完成的。
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